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7-segment display logic synthesis

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Academic year: 2022

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7-segment display logic synthesis

0 0000 1 0001 2 0010 3 0011 4 0100 5 0101 6 0110 7 0111 8 1000 9 1011

Codifica bcd dell’ingresso

x3x2x1x0

y

y

y

y

y y

y

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7-segment display logic synthesis

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7-segment display logic synthesis

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7-segment display logic synthesis

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7-segment display logic synthesis

n x3 x2 x1 x0 y0 y1 y2 y3 y4 y5 y6

0 0 0 0 0 1 1 1 1 1 1 0

1 0 0 0 1 0 0 0 1 1 0 0

2 0 0 1 0 0 1 1 0 1 1 1

3 0 0 1 1 0 0 1 1 1 1 1

4 0 1 0 0 1 0 0 1 1 0 1

5 0 1 0 1 1 0 1 1 0 1 1

6 0 1 1 0 1 1 1 1 0 1 1

7 0 1 1 1 1 0 0 1 1 1 0

8 1 0 0 0 1 1 1 1 1 1 1

9 1 0 0 1 1 0 1 1 1 1 1

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7-segment display logic synthesis

x2x1

x4x3 00 01 11 10

00 1

01 1 1 1 1

11 - - - -

10 1 1 - -

y0

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