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VLSI Design and FPGA Prototyping of an LDPC Codes Decoder for Wi-Fi Applications

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Academic year: 2021

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Università di Pisa Facoltà di Ingegneria

Corso di Laurea in Ingegneria Elettronica (Vecchio Ordinamento) Anno Accademico 2005/2006

Tesi di Laurea

VLSI Design and FPGA Prototyping

of an LDPC Codes Decoder

for Wi-Fi Applications

Relatori: Candidato:

Prof. Ing. Luca FANUCCI Gabriele NOBILI

Prof. Ing. Pierangelo TERRENI

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