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Data: Nome_________________________________________________________ Esito: Tempo a disposizione: 1 ora QUESITO 1 V V V V I I t t L E D : 04_08

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Academic year: 2021

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(1)

L

ABORATORIO

E

LETTRONICA

D

IGITALE

: 04_08 Data:

Nome_________________________________________________________ Esito:

Tempo a disposizione: 1 ora

QUESITO 1

Simulare staticamente e dinamicamente l’inverter TTL-S realizzato in tecnologia “ED”, il cui schema circuitale è riportato in figura. Si completi la tabella con i risultati delle opportune simulazione effettuate tenendo conto delle condizioni specificate sotto la tabella stessa.

V

IL

V

IH

V

OL

V

OH

I

IL*

I

IH#

t

pHL%

t

pLH%

*Valutato con ingresso pari a 0,1 V.

#Valutato con ingresso pari a 3,6 V.

% Valutati facendo variare il segnale d’ingresso tra 0,1 V e 3,6 V con tempi di salita e discesa pari a 500 ps e collegando in uscita alla porta una capacità di valore 1 pF e una resistenza di valore 10 kΩ.

(2)

QUESITO 2

Realizzare usando porte della famiglia logica HC la rete sequenziale sincrona di Moore rappresentata in figura. Si riporti lo schema elettrico del circuito realizzato. Simulare poi il circuito realizzato utilizzando per gli ingressi le forme d’onda specificate di seguito e il modello typical per i ritardi delle porte logiche. Si richiede di disegnare la forma d’onda relativa all’uscita quotando gli istanti in cui si presenta un

cambiamento di stato.

Schema elettrico del circuito realizzato.

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